반도체 폴리싱용 지르코니아 CMP 슬러리 — 화학-기계적 평탄화를 위한 나노 ZrO₂ 연마재
화학-기계적 평탄화 (CMP)는 반도체 제조에서 가장 중요한 공정 단계 중 하나로, 옹스트롬 수준에서 정밀한 재료 제거와 표면 평탄화가 필요합니다. 나노 지르코니아 (ZrO₂) 연마 입자는 특히 얕은 트렌치 분리 (STI) 폴리싱 및 고급 산화물 제거에서 기존 콜로이드 실리카 및 세리아 연마재의 고성능 대안으로 부상하고 있습니다.
CMP를 위한 나노 지르코니아를 선택하는 이유
- 실리카 대비 경도 이점: ZrO₂ 모스 경도 ~8.5 대 SiO₂ ~7. 단위 연마재 농도당 더 높은 기계적 제거 효율, 더 낮은 고형분 로딩 (1–5 wt% 대 실리카의 10–30 wt%) 가능.
- 화학적 조절 가능성: 지르코니아 표면 화학은 양성이온성 — 등전점 (IEP) pH 6–7 — 산화물 (SiO₂)과 질화물 (Si₃N₄) 막 사이의 pH 조절 선택성 허용.
- 세리아보다 낮은 스크래치 경향: CeO₂ 연마재는 우수한 산화물 제거율을 달성하지만 고급 노드 (≤7 nm)에서 깊은 스크래치 생성 경향이 있습니다. 제어된 d50 <80 nm의 나노 ZrO₂는 더 낮은 결함 대안을 제공합니다.
- 밀도: 단사정계 ZrO₂의 경우 5.68 g/cm³ — 실리카 (2.2)보다 높아 낮은 고형분 로딩에서 효과적인 기계적 접촉에 기여합니다.
CMP 응용 분야
01
얕은 트렌치 분리 (STI) 폴리싱
STI CMP는 증착된 SiO₂ 과잉분을 제거하고 웨이퍼 표면을 평탄화합니다. 2–5 wt% 고형분, pH 3–5의 나노 지르코니아 슬러리 달성:
| 지표 | 나노 ZrO₂ 슬러리 | 세리아 슬러리 | 콜로이드 실리카 |
|---|---|---|---|
| 산화물 제거율 (ORR) | 2000–4000 Å/min | 3000–5000 Å/min | 1500–3000 Å/min |
| 산화물:질화물 선택성 | 20–50:1 | 30–100:1 | 3–6:1 |
| 결함 밀도 (>0.1 μm) | <0.05/cm² | 0.05–0.2/cm² | <0.02/cm² |
| 고형분 로딩 | 2–5 wt% | 0.5–2 wt% | 10–30 wt% |
| 연마재 d50 | 40–80 nm | 50–150 nm | 30–100 nm |
02
층간 유전체 (ILD) 산화물 폴리싱
ILD CMP에서 대량 산화물 제거를 위해 지르코니아 슬러리는 세리아의 공격적인 제거와 실리카의 더 부드러운 고로딩 접근 사이의 중간 지점을 제공합니다.
03
고급 패키징 — 하이브리드 본딩 표면 준비
3D IC 스태킹을 위한 하이브리드 본딩은 Cu 및 SiO₂ 표면 모두에서 옹스트롬 이하의 표면 조도 (Ra <0.5 nm)가 필요합니다. d50 <50 nm의 나노 지르코니아 연마재가 최종 폴리싱 단계에서 평가 중입니다.
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CMP 연마재용 나노 지르코니아 사양
| 특성 | 단위 | CMP 등급 요구사항 | SEMITECH 능력 |
|---|---|---|---|
| ZrO₂ 순도 | wt% | ≥99.9 | ≥99.9 |
| 결정 상 | — | 단사정계 또는 정방정계 | 둘 다 가능 |
| 1차 입자 크기 | nm | 20–80 | 20–100 (조정 가능) |
| d50 (분산 중) | nm | <80 | 40–80 |
| BET 비표면적 | m²/g | 15–60 | 15–80 |
| Fe 함량 | ppm | <10 | <5 |
| Na 함량 | ppm | <10 | <5 |
| Al 함량 | ppm | <20 | <10 |
| 입자 형상 | — | 구형/등축 | 등축 |
슬러리 배합 고려사항
- pH 조정: STI 폴리싱을 위한 산성 영역 (pH 2–5); ILD 산화물 제거를 위한 중성~알칼리성 (pH 7–11).
- 산화제: 금속 CMP 단계에서 H₂O₂ (0.5–3 wt%); 산화물 전용 폴리싱에는 일반적으로 불필요.
- 계면활성제/분산제: 입체 안정화 및 선택성 조절을 위한 폴리아크릴산 또는 암모늄 폴리아크릴레이트 0.01–0.1 wt%.
- 킬레이트제: 하이브리드 본딩 응용에서 Cu 복합화를 위한 아미노산 (글리신, 프롤린) 또는 유기산.
SEMITECH를 선택하는 이유
반도체 공급망이 요구하는 순도 문서 (ICP-OES 전체 금속 스캔, DLS에 의한 PSD, XRD 상 식별)와 함께 일본 수입 가격보다 30–40% 낮은 중국 직접 가격을 제공합니다.
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